FPGA TSN 乙太網開發服務範圍
圍繞確認的專案輸入、工作內容、交付物與驗收條件組織實施；是否進入 PoC 或完整開發階段由雙方確認的任務書確定。
適用專案
- 已有目標產品或板卡，需要補齊“IEEE 802.1AS”相關設計與實現
- 已有程式碼或 IP，需要圍繞“時間同步”完成整合、除錯或重構
- 平臺、器件或介面尚未凍結，需要先驗證“流量整形”等關鍵風險
主要工作內容
- 凍結 TSN 子標準與裝置角色：先將“凍結 TSN 子標準與裝置角色”寫入需求與介面基線，明確“IEEE 802.1AS”涉及的物件、引數、依賴和透過條件。
- 設計 gPTP 時間同步與時間戳路徑：圍繞“設計 gPTP 時間同步與時間戳路徑”形成專項設計，記錄“時間同步”相關架構、配置、約束和版本。
- 配置佇列、門控與流量整形：針對“配置佇列、門控與流量整形”完成工程整合，保留“流量整形”相關構建、日誌、問題定位和變更記錄。
- 完成拓撲聯調和端到端時延測試：以“完成拓撲聯調和端到端時延測試”為驗證重點，在約定環境中執行“佇列與排程”相關測試並提交可複核結果。
專案輸入
- 採用的 802.1AS、802.1Qbv、802.1Qav、802.1Qbu 等標準範圍
- Grandmaster、Bridge、Endpoint 角色及網路拓撲
- 業務流數量、週期、頻寬、優先順序和時延預算
- MAC/PCS、PHY、交換晶片、協議棧、測試儀和對端資料
交付物
- TSN 資料路徑、時間戳和排程相關 RTL/IP 整合工程：“TSN 資料路徑、時間戳和排程相關 RTL/IP 整合工程”用於復現約定實現，提交時繫結目標器件、工具、依賴和原始碼版本。
- 時鐘域、佇列、門控表和流量引數說明：“時鐘域、佇列、門控表和流量引數說明”說明介面、引數、配置與限制，作為系統聯調和後續維護依據。
- 配置指令碼、暫存器表及主機或處理器介面說明：“配置指令碼、暫存器表及主機或處理器介面說明”按任務書列明檔案範圍、第三方授權邊界、構建方法和製品校驗值。
- 同步偏差、排程行為、擁塞和端到端時延測試記錄：“同步偏差、排程行為、擁塞和端到端時延測試記錄”繫結測試物件、環境、用例、結果與剩餘限制，作為階段或最終驗收證據。
驗收方法
- 使用任務書指定的 TSN 子標準、角色和拓撲完成互操作
- 時間同步偏差按指定測量點、儀器和統計口徑記錄
- 關鍵業務流在約定負載下滿足時延和抖動條件
- 失步、擁塞、重連和異常時鐘用例有可複核記錄
能力與結果邊界
採用的 TSN 子標準、交換拓撲、對端和一致性要求必須在立項時凍結。 未經目標專案驗證的廠商引數、理論峰值、路線圖或示例工程不作為專案實測結果；最終結論以凍結版本和書面測試證據為準。
FPGA TSN 乙太網開發常見問題
TSN 開發是否等同於普通千兆乙太網開發？
不等同。除 MAC/PHY 資料收發外，還需明確時間同步、流分類、佇列排程、門控和端到端測試方法。
TSN 頁面中的時延如何驗收？
需要指定報文流、負載、網路跳數、入口和出口測量點、時間源、儀器精度、統計視窗及最大值或分位數口徑。
哪些 TSN 功能必須由 FPGA 實現？
沒有統一答案。時間戳、排程、交換、協議棧和管理面可分佈在 FPGA、交換晶片或處理器中，應先凍結系統架構。
FPGA TSN 乙太網開發的交付範圍如何確定？
以專案任務書為準。計劃交付的TSN 資料路徑、時間戳和排程相關 RTL/IP 整合工程、時鐘域、佇列、門控表和流量引數說明等內容需逐項列明；第三方 IP、加密網表、廠商庫、協議資料和許可證檔案受原授許可權制。
FPGA TSN 乙太網開發週期和報價如何評估？
工作量取決於輸入完整度、介面和模組數量、器件與工具成熟度、第三方 IP、板卡狀態、軟體配套、測試裝置及驗收深度。完成輸入審查後再形成階段計劃與報價。
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